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[主观题]

图是用16×4位ROM和同步十六进制加法计数器CT74161组成的脉冲分频器电路,ROM中的数据如表所示。试画出在CP信

号连续作用下D3、D2、D1、D0输出的电压波形,并说明它们和CP信号频率之比。

图是用16×4位ROM和同步十六进制加法计数器CT74161组成的脉冲分频器电路,ROM中的数据如表图是用16×4位ROM和同步十六进制加法计数器CT74161组成的脉冲分频器电路,ROM中的数据如表

地址输入数据输出
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更多“图是用16×4位ROM和同步十六进制加法计数器CT74161组成的脉冲分频器电路,ROM中的数据如表所示。试画出在CP信”相关的问题

第1题

由16×4位ROM和4位二进制加法计数器74LS161组成的脉冲分配电路如图7-13所示,ROM输入和输出关系如表7-4所示。

由16×4位ROM和4位二进制加法计数器74LS161组成的脉冲分配电路如图7-13所示,ROM输入和输出关系如表7-4所示。试画出在CLK信号作用下D3、D2、D1、D0的波形。

表7-4 R0M输入和输出关系

地址输入数据输出
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第2题

用16×4位的ROM设计一个将两位二进制数相乘的乘法器电路,列出真值表,画出存储矩阵的点阵图。

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第3题

用16×4位的ROM设计一个将2个2位二进制数相乘的乘法器电路,列出ROM的数据表,画出存储矩阵的点阵图。

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第4题

图P11.5所示电路是用CB7520和同步十六进制计数器74LS161组成的波形发生器电路.已知CB7520的,试

图P11.5所示电路是用CB7520和同步十六进制计数器74LS161组成的波形发生器电路.已知CB7520的,试画出输出电压v0的波形,并标出波形图上各点电压的幅度.

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第5题

设计一个用移位相加实现的乘法器,乘数与被乘数均为同步输入的4位无符号二进制数。要求:(1)确定乘法器算法,画出乘法器系统方案框图。(2)画出系统控制器的ASM图。用一个触发器对应一个状态的方法设计控制电路。(3)用VerilogHDL语言描述系统的工作过程。

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第6题

试分析图题6.5.14所示计数器,画出它的状态图,并确定它的模。(74xx163是具有同步清零功能的4位

试分析图题6.5.14所示计数器,画出它的状态图,并确定它的模。(74xx163是具有同步清零功能的4位同步二进制递增计数器,其他功能与74xx161相同)

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第7题

试确定用ROM实现下列逻辑函数所需容量: (1)实现两个4位二进制数相乘的乘法器; (2)将8

试确定用ROM实现下列逻辑函数所需容量: (1)实现两个4位二进制数相乘的乘法器; (2)将8位二进制数转换为8421BCD码的转换电路。

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第8题

用一片如图A1-4所示的4位二进制加法计数器74161和必要的逻辑门电路设计一个可控计数器,要求当控制信号M=1时

用一片如图A1-4所示的4位二进制加法计数器74161和必要的逻辑门电路设计一个可控计数器,要求当控制信号M=1时,实现七进制计数器;而当控制信号M=0时,实现十三进制计数器。画出所设计的可控计数器的逻辑电路。

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第9题

用4位二进制加法计数器74161构成的计数器电路如图所示,则对该计数器应用电路功能描述正确的是()。

A.余3码编码的十进制加法计数器

B.循环码编码的九进制加法计数器

C.余3码编码的三进制加法计数器

D.循环码编码的二进制加法计数器

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第10题

图5.28(a)所示电路为同步十进制加法计数器74160和3-8译码器74138组成的电路,74138输出低电平
图5.28(a)所示电路为同步十进制加法计数器74160和3-8译码器74138组成的电路,74138输出低电平

有效,使能端处于有效状态.

(1)74160构成多少进制计数器.

(2)假定74160初始状态Q3Q2Q1Q0=0000,试对应图5.28(b)的CP脉冲图画出Q3、Q2、Q1、Q0和Y的输出波形.

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第11题

试分析图4所示的计数器在M=1和M=0时各为几进制。同步十进制加法计数器74160的功能表如表1所示。

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