用PAL16R4设计一个4位的双向移位寄存器。（注：本书末尾的附页2是PAL16R4的逻辑图，可作为习题纸使用。)

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发布时间：2022-06-03

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第1题

用PAL16R4设计一个4位的格雷码计数器（参见上题注)。

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第2题

设计一个用移位相加实现的乘法器，乘数与被乘数均为同步输入的4位无符号二进制数。要求：（1)确定乘法器算法，画出乘法器系统方案框图。（2)画出系统控制器的ASM图。用一个触发器对应一个状态的方法设计控制电路。（3)用VerilogHDL语言描述系统的工作过程。

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第3题

用ISP技术设计一个可控计数器.当控制信号X=0时,为8421码十进制计数器;当X=1时,为4位二进制计数器.用VHDL语言写出设计源文件.

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第4题

设计一个4位奇偶校验器，当4位数中有奇数个1时，输出为0，否则输出为1。要求进行逻辑功能分析（真值表、逻辑表达式），基本逻辑门用VHDL语言设计描述，并进行功能仿真。

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第5题

试用4片4位双向移位寄存器74LS194A(见图P6.7)接成一个16位双向移位寄存器。74LS194A可用框图表示。

试用4片4位双向移位寄存器74LS194A（见图P6.7)接成一个16位双向移位寄存器。74LS194A可用框图表示。

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第6题

用PAL16L8设计一个代码转换电路，将输人的BCD代码转换为输出的4位格雷码。两种代码的对照表见本书第1章表1.2.1和表1.2.2（参见上题注)。

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第7题

试分析图P8.5给出的用PAL16R4构成的时序逻辑电路,写出电路的驱动方程、状态方程、输出方程,画出

电路的状态转换图.工作时,11脚接低电平.

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第8题

有一个十进制数加法运算系统,它利用4位二进制数加法器对一位8421BCD码进行加法运算.其操作过程如下:先将两个1位十进制数存入寄存器A和B,然后进行相加.如果和数等于或小于9,则运算结果正确;如果和数大于10,还需要对运算结果进行加6(0110)修正,这是因为用二进制数表示十进制数时,多余了6种状态.(1)请设计系统方框图;(2)请设计ASM流程图.

有一个十进制数加法运算系统,它利用4位二进制数加法器对一位8421BCD码进行加法运算.其操作过程如下:先将两个1位十进制数存入寄存器A和B,然后进行相加.如果和数等于或小于9,则运算结果正确;如果和数大于10,还需要对运算结果进行加6（0110)修正,这是因为用二进制数表示十进制数时,多余了6种状态.（1)请设计系统方框图;（2)请设计ASM流程图.

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第9题

用二进制数表示一个4位的十进制数，至少需要（)位。

A.11

B.12

C.13

D.14

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第10题

设计一个数据处理电路，输入数据A和B各为4位二进制数。当A＞B时，要求给出A＞B的信号和A-B的数值;当A＜B时，要求给出A＜B的信号和B-A的数值。

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