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[单选题]

一个逻辑电路，只有当所有输入端均为高电平时，输出端才是低电平，否则输出端总是高电平，这是个（)电路。

A.与门

B.非门

C.与非门

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发布时间：2022-06-21

更多“一个逻辑电路，只有当所有输入端均为高电平时，输出端才是低电平，否则输出端总是高电平，这是个()电路。”相关的问题

第1题

或非门逻辑关系的特点是：只有当两个输入端都为高电平时，输出端才为高电平；只要有一个输入端是高电平，输出端就输出低电平。（）

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第2题

异或门逻辑关系的特点是：只有当两个输入端彼此一致时，输出端才为高电平;只要两个输入端一致，输出端就输出低电平。（)

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第3题

在正逻辑系统中，若要求“与”门输出高电平，则其输入端（)。

A.全为低电平

B.全为高电平

C.只要由一个低电平

D.只要有一个高电平

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第4题

在正逻辑系统中，若要求“或”门输出端为低电平，则其输入端（)。

A.全为低电平

B.全为高电平

C.只要由一个低电平

D.只要有一个高电平

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第5题

在NMOS或非门中，电路只要有一个输入端是高电平，对应的工作管就导通了，输出就是低电平。（)

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第6题

当与门所有输入均为高电平时，其输出是()电平。

当与门所有输入均为高电平时，其输出是（)电平。

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第7题

设计一个具有控制端C的4输入A3A2A1A0，4输出L3L2L1L0的逻辑电路，当C=0，输出输入状态相反，C=1，输入输出状态相同。

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第8题

设计一个控制步进电动机用的三相六拍工作的逻辑电路.如果用1表示线圈通电,0表示线圈断电,设正

转时控制输入端M=1,反转时M=0,则三个线圈ABC的状态转换图应如图P5.10所示.

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第9题

采用D触发器和尽量少的门电路设计一个串行数据检测器,该电路具有1个数据输入端D和1个时钟端口,

1个信号输出端F.当连续3个时钟触发时D都为1或都为0,则F输出高电平,否则输出低电平.写出电路的转移/输出表,画出逻辑电路图.

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第10题

试用五个2 输入端或门、一个与门和两个非门实现语句"A＞B" ，A和B均为两位二进制数。

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第11题

TTL与非门电路的输入端悬空从逻辑上讲相当于（)。

A.接高电平

B.接低电平

C.没有电平

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