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[主观题]

已知图2.4所示各电路都是TTL门,试简述各门电路的输出是什么状态(高电平、低电平或高阻态),要求

已知图2.4所示各电路都是TTL门,试简述各门电路的输出是什么状态(高电平、低电平或高阻态),要求

写出表达式.

已知图2.4所示各电路都是TTL门,试简述各门电路的输出是什么状态(高电平、低电平或高阻态),要求已

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第1题

试判断如图2.11所示的电路能否按各图所要求的逻辑关系正常工作?若不能正常工作,请做相应的改动
.若电路接法有错,改电路:若电路正确但给定的逻辑关系不对,则写出正确的逻辑表达式.能正常工作的在图中括号内打“√",否则打“x".已知TTL门的IOH=0.4mA,IOL=10mA,UOH=3.6V,UOL=0.3V,CMOS门的VDD=5V,UOH=5V,UOL=0V,IOH=0.51mA,IOL=0.51mA.

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第2题

图LT4-7所示电路中,已知晶体三极管β=150,VA=-100V,VBE(OD)=0.7V,试求设各电容对交流呈
图LT4-7所示电路中,已知晶体三极管β=150,VA=-100V,VBE(OD)=0.7V,试求设各电容对交流呈

图LT4-7所示电路中,已知晶体三极管β=150,VA=-100V,VBE(OD)=0.7V,试求设各电容对交流呈短路.

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第3题

图LT6-2所示电路,已知υs1=5mV、υs2=-5mV、υs3=6mV、υs4=-12mV,试求输出电压υ0⌘

图LT6-2所示电路,已知υs1=5mV、υs2=-5mV、υs3=6mV、υs4=-12mV,试求输出电压υ0值.设各集成运放是理想的.

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第4题

图LT6-2所示电路,已知vSI=5mV、vS2=-5mV、vS3=6mV、vS4=-12mV,试求输出电压vΩ⌘

图LT6-2所示电路,已知vSI=5mV、vS2=-5mV、vS3=6mV、vS4=-12mV,试求输出电压vΩ值。设各集成运放是理想的。

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第5题

在图LP4-5所示电路中,已知晶体三极管特性相同,β=100,ΥBE(on)=0.7Υ,要求IEQ1=0.5m
在图LP4-5所示电路中,已知晶体三极管特性相同,β=100,ΥBE(on)=0.7Υ,要求IEQ1=0.5m

A,IEQ2=1mA,ΥCEQ1=2.5Υ,ΥCEQ2=4Υ.设ΥCC=12Υ,ΥCQ2=6Υ,I1=10IBQ,试计算各电阻值,

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第6题

图P11.5所示电路是用CB7520和同步十六进制计数器74LS161组成的波形发生器电路.已知CB7520的,试

图P11.5所示电路是用CB7520和同步十六进制计数器74LS161组成的波形发生器电路.已知CB7520的,试画出输出电压v0的波形,并标出波形图上各点电压的幅度.

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第7题

图LT5-7所示为电流并联负反馈电路,已知RF1=750Ω,RF2=1.2kΩ,RS=1kΩ,R02=4kΩ,R≇

图LT5-7所示为电流并联负反馈电路,已知RF1=750Ω,RF2=1.2kΩ,RS=1kΩ,R02=4kΩ,RL=1kΩ,Rf=10kΩ,设各电容对交流呈短路,RB1、RB2忽略不计,试在深度负反馈条件下,求

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第8题

图LT4-15所示电路,已知场效应管的gm、三极管的β、rbc及各电阻值,rds与rce忽略不
计.(1)试指出放大电路由哪两种组态组合而成.(2)写出R1、R0、Av的表达式.

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第9题

TTL边沿触发器组成的电路分别如图P4.8(a)和(b)所示,其输入波形如图P4.8(c)所示,试分别画出Q1

TTL边沿触发器组成的电路分别如图P4.8(a)和(b)所示,其输入波形如图P4.8(c)所示,试分别画出Q1和Q2端的波形.设各电路的初始状态均为0.

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第10题

图LP5-25(a)所示为某集成运放的内部电路框图,它为无零三极系统,各极点角频率值由相应的R和C决
图LP5-25(a)所示为某集成运放的内部电路框图,它为无零三极系统,各极点角频率值由相应的R和C决

定,已知 若把它接成图LP5-25(b)所示的同相放大电路,为保证反馈放大器稳定工作,可采用简单电容补偿,亦可采用如图LP5-25(c)所示的密勒电容补偿,图中gm=试求两种补偿时所需的电容值.设密勒补偿时各级的输入和输出电阻对电路影响忽略不计.

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