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[主观题]

在图P5.12（a)下降触发D触发器中，已知时钟脉冲CLK、输入端D、异步置位输入端RD和异步复位输入端RD的

在图P5.12(a)下降触发D触发器中，已知时钟脉冲CLK、输入端D、异步置位输入端RD和异步复位输入端RD的电压波形如图P5.12(b)中所示，试画出输出端Q对应的电压波形。

在图P5.12（a)下降触发D触发器中，已知时钟脉冲CLK、输入端D、异步置位输入端RD和异步复位输

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发布时间：2022-10-28

更多“在图P5.12（a)下降触发D触发器中，已知时钟脉冲CLK、输入端D、异步置位输入端RD和异步复位输入端RD的”相关的问题

第1题

‍实验中基本RS触发器采用的触发方式是（)。‌

A.电平触发，高电平有效

B.上升沿触发

C.下降沿触发

D.电平触发，低电平有效

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第2题

按触发器触发方式的不同，双稳态触发器可分为（)。

A.高电平触发和低电平触发

B.上升沿触发和下降沿触发

C.电平触发或边沿触发

D.输入触发或时钟触发

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第3题

画出图P5.4(a)中电平触发SR触发器Q和Q'端的电压波形。时钟脉冲CLK和输入S、R的电压波形如图P5.

画出图P5.4（a)中电平触发SR触发器Q和Q'端的电压波形。时钟脉冲CLK和输入S、R的电压波形如图P5.

4(b)所示。设触发器的初始状态为Q=0。

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第4题

画出图P5.8(a)中脉冲触发JK触发器输出端Q和Q'的电压波形。时钟脉冲CLK和输入J、K的电压波形如

画出图P5.8（a)中脉冲触发JK触发器输出端Q和Q'的电压波形。时钟脉冲CLK和输入J、K的电压波形如

图P5.8(b)所示。设触发器的初始状态为Q=0。

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第5题

图2-5所示电路为由555定时器构成的()。

A.施密特触发电路

B.多谐振荡器

C.单稳态触发器

D.T触发器

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第6题

本实验中门电路构成的单稳触发器电路对输入信号的触发条件为（)。

A.下降沿触发

B.电平触发

C.上升沿触发

D.脉宽触发

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第7题

集成触发器74LS74芯片的触发方式为（)。

A.时钟上升沿

B.时钟下降沿

C.上升和下降沿都有效

D.不受时钟控制

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第8题

图P5.11(a)是带有异步置零端的上升沿触发D触发器，CLK、RD和D端的电压波形如图P5.11(b)中所给出。试

图P5.11（a)是带有异步置零端的上升沿触发D触发器，CLK、RD和D端的电压波形如图P5.11（b)中所给出。试

画出触发器输出端Q对应的电压波形。

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第9题

试用下降沿触发的JK触发器设计一个状态转换图如图5.10所示的异步计数电路.

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第10题

在负边沿触发的JK触发器中J=K=0，初态为0，CP脉冲作用后触发器下一个状态为（)

A.0

B.1

C.翻转

D.不定

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第11题

触发器在插入、删除或修改特定表中的数据时触发执行。（)

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